蚀刻方法和等离子体处理装置.pdf

《蚀刻方法和等离子体处理装置.pdf》由会员分享，可在线阅读，更多相关《蚀刻方法和等离子体处理装置.pdf（25页完成版）》请在专利查询网上搜索。

1、(19)国家知识产权局(12)发明专利申请(10)申请公布号 (43)申请公布日 (21)申请号 202310063138.5(22)申请日 2023.01.18(30)优先权数据2022-011043 2022.01.27 JP(71)申请人 东京毅力科创株式会社地址 日本东京都(72)发明人 松尾瑞稀(74)专利代理机构 北京林达刘知识产权代理事务所(普通合伙)11277专利代理师 刘新宇李靖(51)Int.Cl.H01L 21/311(2006.01)H01L 21/67(2006.01)H10B 41/35(2023.01)H10B 41/20(2023.01)H10B 43/35(2。

2、023.01)H10B 43/20(2023.01)C09K 13/00(2006.01)H01J 37/32(2006.01)(54)发明名称蚀刻方法和等离子体处理装置(57)摘要本发明提供一种蚀刻方法和等离子体处理装置，能够形成具有良好形状的凹部。蚀刻方法包括以下工序：工序(a)，准备基板，基板具有含硅膜以及含硅膜上的掩模；工序(b)，在工序(a)之后，利用从第一处理气体生成的第一等离子体对含硅膜进行蚀刻来形成凹部；工序(c)，在工序(b)之后，向基板供给从包含钨的第二处理气体生成的第二等离子体；以及工序(d)，在工序(c)之后，利用从第三处理气体生成的第三等离子体对凹部进行蚀刻。权利要求。

3、书2页 说明书10页 附图12页CN 116504623 A2023.07.28CN 116504623 A1.一种蚀刻方法，包括以下工序：工序(a)，准备基板，所述基板具有含硅膜以及所述含硅膜上的掩模；工序(b)，在所述工序(a)之后，利用从第一处理气体生成的第一等离子体对所述含硅膜进行蚀刻来形成凹部；工序(c)，在所述工序(b)之后，向所述基板供给从包含钨的第二处理气体生成的第二等离子体；以及工序(d)，在所述工序(c)之后，利用从第三处理气体生成的第三等离子体对所述凹部进行蚀刻。2.根据权利要求1所述的蚀刻方法，其特征在于，在所述工序(c)中，在所述凹部的侧壁形成含钨层。3.根据权利要求。

4、1或2所述的蚀刻方法，其特征在于，在所述工序(b)中，在第一压力下生成所述第一等离子体，在所述工序(c)中，在比所述第一压力高的第二压力下生成所述第二等离子体。4.根据权利要求1至3中的任一项所述的蚀刻方法，其特征在于，在所述工序(b)中，供给第一高频电力，以生成所述第一等离子体，在所述工序(c)中，供给比所述第一高频电力小的第二高频电力，以生成所述第二等离子体。5.根据权利要求1至4中的任一项所述的蚀刻方法，其特征在于，在所述工序(b)与所述工序(c)之间还包括工序(e)，在所述工序(e)中，将通过所述工序(b)沉积于所述掩模的开口的沉积物去除。6.根据权利要求1至5中的任一项所述的蚀刻方法。

5、，其特征在于，在所述工序(b)与所述工序(c)之间还包括工序(f)，在所述工序(f)中，向所述基板供给从包含含氧气体的第四处理气体生成的第四等离子体。7.根据权利要求1至6中的任一项所述的蚀刻方法，其特征在于，在所述工序(d)之后，重复进行所述工序(c)和所述工序(d)。8.根据权利要求1至7中的任一项所述的蚀刻方法，其特征在于，所述含硅膜包括第一层和第二层，所述第一层包含含有硅的第一材料，所述第二层包含与第一材料不同的第二材料，所述第一层与所述第二层交替地层叠。9.根据权利要求8所述的蚀刻方法，其特征在于，所述第一材料包含硅氧化物。10.根据权利要求8或9所述的蚀刻方法，其特征在于，所述第二。

6、材料包含硅氮化物。11.根据权利要求1至10中的任一项所述的蚀刻方法，其特征在于，所述第二处理气体包含含钨气体。12.根据权利要求1至11中的任一项所述的蚀刻方法，其特征在于，所述第二处理气体包含六氟化钨气体。13.根据权利要求1至12中的任一项所述的蚀刻方法，其特征在于，所述第一处理气体包含CxHyFz气体，其中，x和z为1以上的整数，y为0以上的整数。14.根据权利要求1至13中的任一项所述的蚀刻方法，其特征在于，权利要求书1/2 页2CN 116504623 A2所述第三处理气体包含CxHyFz气体，其中，x和z为1以上的整数，y为0以上的整数。15.一种蚀刻方法，包括以下工序：工序(a。

7、)，准备基板，所述基板具有含硅膜以及所述含硅膜上的掩模，所述含硅膜包括交替地层叠的硅氧化膜和硅氮化膜；工序(b)，在所述工序(a)之后，利用从包含CxHyFz气体和含氧气体的第一处理气体生成的第一等离子体对所述含硅膜进行蚀刻来形成凹部，其中，x和z为1以上的整数，y为0以上的整数；工序(c)，在所述工序(b)之后，通过向所述基板供给从包含六氟化钨气体的第二处理气体生成的第二等离子体，来在所述凹部的侧壁形成含钨层；以及工序(d)，在所述工序(c)之后，利用从包含CxHyFz气体和含氧气体的第三处理气体生成的第三等离子体对所述凹部进行蚀刻，其中，x和z为1以上的整数，y为0以上的整数。16.一种等。

8、离子体处理装置，具备：腔室；基板支承器，其用于在所述腔室内支承基板，所述基板具有含硅膜以及所述含硅膜上的掩模；气体供给部，其构成为向所述腔室内供给第一处理气体、第二处理气体以及第三处理气体，所述第二处理气体包含钨；等离子体生成部，其构成为在所述腔室内从所述第一处理气体、所述第二处理气体以及所述第三处理气体分别生成第一等离子体、第二等离子体以及第三等离子体；以及控制部，其中，所述控制部构成为对所述气体供给部和所述等离子体生成部进行控制，以进行以下工序：利用所述第一等离子体对所述含硅膜进行蚀刻来形成凹部；在形成所述凹部之后，向所述基板供给所述第二等离子体；以及在向所述基板供给所述第二等离子体之后，。

9、利用所述第三等离子体对所述凹部进行蚀刻。权利要求书2/2 页3CN 116504623 A3蚀刻方法和等离子体处理装置技术领域0001本公开的例示性的实施方式涉及一种蚀刻方法和等离子体处理装置。背景技术0002在电子器件的制造中，利用等离子体进行含硅膜的蚀刻。含硅膜由氧化硅、氮化硅之类的含硅材料形成。例如，在具有三维构造的NAND型闪存的制造中，对包括作为含硅膜而交替地层叠的多个硅氧化膜及多个硅氮化膜的多层膜进行蚀刻。在含硅膜的蚀刻中，作为掩模，使用含有无定形碳之类的碳的掩模。在掩模形成有开口。0003在专利文献1中关于多层膜的蚀刻进行了记载。在专利文献1所记载的蚀刻中，生成氢氟烃气体的等离子。

10、体，利用来自等离子体的氟的活性种对多层膜进行蚀刻。在多层膜的蚀刻中，在掩模上形成含有碳的沉积物，通过该沉积物来保护掩模。0004现有技术文献0005专利文献0006专利文献1：美国专利申请公开第2013/0059450号说明书发明内容0007发明要解决的问题0008本公开提供一种能够形成具有良好形状的凹部的蚀刻方法和等离子体处理装置。0009用于解决问题的方案0010在一个例示性的实施方式中，蚀刻方法包括以下工序：工序(a)，准备基板，所述基板具有含硅膜以及所述含硅膜上的掩模；工序(b)，在所述工序(a)之后，利用从第一处理气体生成的第一等离子体对所述含硅膜进行蚀刻来形成凹部；工序(c)，在所。

11、述工序(b)之后，向所述基板供给从包含钨的第二处理气体生成的第二等离子体；以及工序(d)，在所述工序(c)之后，利用从第三处理气体生成的第三等离子体对所述凹部进行蚀刻。0011发明的效果0012根据一个例示性的实施方式，提供一种能够形成具有良好形状的凹部的蚀刻方法和等离子体处理装置。附图说明0013图1是概要性地示出一个例示性的实施方式所涉及的等离子体处理装置的图。0014图2是概要性地示出一个例示性的实施方式所涉及的等离子体处理装置的图。0015图3是一个例示性的实施方式所涉及的蚀刻方法的流程图。0016图4是能够应用图3的方法的一例的基板的截面图。0017图5是示出一个例示性的实施方式所涉。

12、及的蚀刻方法的一个工序的截面图。0018图6是示出一个例示性的实施方式所涉及的蚀刻方法的一个工序的截面图。0019图7是示出一个例示性的实施方式所涉及的蚀刻方法的一个工序的截面图。说明书1/10 页4CN 116504623 A40020图8是示出一个例示性的实施方式所涉及的蚀刻方法的一个工序的俯视图。0021图9是沿着图8的IXIX线进行剖切所得到的截面图。0022图10是示出通过蚀刻形成的凹部的边缘粗糙度发生恶化的机理的例子的截面图。0023图11是示出通过蚀刻形成的凹部的边缘粗糙度得到改善的机理的例子的截面图。0024图12是示意性地示出在第四实验和第五实验中通过蚀刻形成的凹部的例子的俯。

13、视图。具体实施方式0025下面，对各种例示性的实施方式进行说明。0026在一个例示性的实施方式中，蚀刻方法包括以下工序：工序(a)，准备基板，所述基板具有含硅膜以及所述含硅膜上的掩模；工序(b)，在所述工序(a)之后，利用从第一处理气体生成的第一等离子体对所述含硅膜进行蚀刻来形成凹部；工序(c)，在所述工序(b)之后，向所述基板供给从包含钨的第二处理气体生成的第二等离子体；以及工序(d)，在所述工序(c)之后，利用从第三处理气体生成的第三等离子体对所述凹部进行蚀刻。0027根据上述蚀刻方法，能够改善凹部的边缘粗糙度。因而，能够形成具有良好形状的凹部。推测机理如下，但并不限定于此。在通过蚀刻形成。

14、凹部时，在凹部的侧壁不均匀地带电有正电荷，由此在凹部的侧壁的一部分形成正的带电区域。在不进行工序(c)的情况下，用于蚀刻的等离子体中的正离子在正的带电区域反弹而对相反的侧壁进行蚀刻。由此，导致凹部的边缘粗糙度恶化。另一方面，当进行工序(c)时，在凹部的侧壁形成导电性的含钨层，因此能够去除带电的侧壁的正电荷。因而，正离子的直进性提高，因此凹部的边缘粗糙度得到改善。0028也可以是，在所述工序(c)中，在所述凹部的侧壁形成含钨层。在该情况下，能够通过含钨层去除凹部的侧壁的电荷。0029也可以是，在所述工序(b)中，在第一压力下生成所述第一等离子体，在所述工序(c)中，在比所述第一压力高的第二压力下。

15、生成所述第二等离子体。在该情况下，在工序(c)中，容易在凹部的侧壁形成含钨层。0030也可以是，在所述工序(b)中，供给第一高频电力，以生成所述第一等离子体，在所述工序(c)中，供给比所述第一高频电力小的第二高频电力，以生成所述第二等离子体。在该情况下，在工序(c)中，容易在凹部的侧壁形成含钨层。0031也可以是，上述蚀刻方法在所述工序(b)与所述工序(c)之间还包括工序(e)，在所述工序(e)中，将通过所述工序(b)沉积于所述掩模的开口的沉积物去除。在该情况下，能够抑制掩模的开口的尺寸的缩小。0032也可以是，上述蚀刻方法在所述工序(b)与所述工序(c)之间还包括工序(f)，在所述工序(f)。

16、中，向所述基板供给从包含含氧气体的第四处理气体生成的第四等离子体。在该情况下，能够去除附着于基板的有机物。0033也可以是，在所述工序(d)之后，重复进行所述工序(c)和所述工序(d)。在该情况下，能够进一步改善凹部的边缘粗糙度。0034也可以是，所述含硅膜包括第一层和第二层，所述第一层包含含有硅的第一材料，所述第二层包含与第一材料不同的第二材料，所述第一层与所述第二层交替地层叠。说明书2/10 页5CN 116504623 A50035也可以是，所述第一材料包含硅氧化物。0036也可以是，所述第二材料包含硅氮化物0037也可以是，所述第二处理气体包含含钨气体。0038也可以是，所述第二处理气。

17、体包含六氟化钨气体。0039也可以是，所述第一处理气体包含CxHyFz(x和z为1以上的整数，y为0以上的整数)气体。0040也可以是，所述第三处理气体包含CxHyFz(x和z为1以上的整数，y为0以上的整数)气体。0041在一个例示性的实施方式中，蚀刻方法包括以下工序：工序(a)，准备基板，所述基板具有含硅膜以及所述含硅膜上的掩模，所述含硅膜包括交替地层叠的硅氧化膜和硅氮化膜；工序(b)，在所述工序(a)之后，利用从包含CxHyFz(x和z为1以上的整数，y为0以上的整数)气体和含氧气体的第一处理气体生成的第一等离子体对所述含硅膜进行蚀刻来形成凹部；工序(c)，在所述工序(b)之后，通过向所。

18、述基板供给从包含六氟化钨气体的第二处理气体生成的第二等离子体，来在所述凹部的侧壁形成含钨层；以及工序(d)，在所述工序(c)之后，利用从包含CxHyFz(x和z为1以上的整数，y为0以上的整数)气体和含氧气体的第三处理气体生成的第三等离子体对所述凹部进行蚀刻。0042在一个例示性的实施方式中，等离子体处理装置具备：腔室；基板支承器，其用于在所述腔室内支承基板，所述基板具有含硅膜以及所述含硅膜上的掩模；气体供给部，其构成为向所述腔室内供给第一处理气体、第二处理气体以及第三处理气体，所述第二处理气体包含钨；等离子体生成部，其构成为在所述腔室内从所述第一处理气体、所述第二处理气体以及所述第三处理气体。

19、分别生成第一等离子体、第二等离子体以及第三等离子体；以及控制部，其中，所述控制部构成为对所述气体供给部和所述等离子体生成部进行控制，以进行以下工序：利用所述第一等离子体对所述含硅膜进行蚀刻来形成凹部；在形成所述凹部之后，向所述基板供给所述第二等离子体；以及在向所述基板供给所述第二等离子体之后，利用所述第三等离子体对所述凹部进行蚀刻。0043下面，参照附图来对各种例示性的实施方式详细地进行说明。此外，在各附图中对相同或相当的部分标注相同的附图标记。0044图1是用于说明等离子体处理系统的结构例的图。在一个实施方式中，等离子体处理系统包括等离子体处理装置1和控制部2。等离子体处理系统是基板处理系统。

20、的一例，等离子体处理装置1是基板处理装置的一例。等离子体处理装置1包括等离子体处理腔室10、基板支承部11以及等离子体生成部12。等离子体处理腔室10具有等离子体处理空间。另外，等离子体处理腔室10具有用于向等离子体处理空间供给至少一种处理气体的至少一个气体供给口、以及用于从等离子体处理空间排出气体的至少一个气体排出口。气体供给口与后述的气体供给部20连接，气体排出口与后述的排气系统40连接。基板支承部11配置于等离子体处理空间内，所述基板支承部11具有用于支承基板的基板支承面。0045等离子体生成部12构成为从供给到等离子体处理空间内的至少一种处理气体生成等离子体。在等离子体处理空间中形成的。

21、等离子体可以是电容耦合等离子体(CCP；Capacitively Coupled Plasma)、电感耦合等离子体(ICP；Inductively Coupled Plasma)、ECR等离子体(ElectronCyclotronresonance plasma：电子回旋共振等离子说明书3/10 页6CN 116504623 A6体)、螺旋波激励等离子体(HWP：Helicon Wave Plasma)或表面波等离子体(SWP：Surface Wave Plasma)等。另外，也可以使用包括AC(Alternating Current：交流)等离子体生成部和DC(Direct Current：。

22、直流)等离子体生成部的各种类型的等离子体生成部。在一个实施方式中，AC等离子体生成部所使用的AC信号(AC电力)具有100kHz10GHz的范围内的频率。因而，AC信号包括RF(Radio Frequency：射频)信号和微波信号。在一个实施方式中，RF信号具有100kHz150MHz的范围内的频率。0046控制部2对用于使等离子体处理装置1执行本公开中叙述的各种工序的可由计算机执行的命令进行处理。控制部2能够构成为控制等离子体处理装置1的各要素，以执行在此叙述的各种工序。在一个实施方式中，控制部2的一部分或全部可以被包括于等离子体处理装置1中。控制部2可以包括处理部2a1、存储部2a2以及通。

23、信接口2a3。控制部2例如由计算机2a实现。计算机2a1能够构成为通过从存储部2a2读出程序并执行所读出的程序来进行各种控制动作。该程序可以预先保存于存储部2a2中，也可以在需要时经由介质获取该程序。获取到的程序保存于存储部2a2中，由处理部2a1从存储部2a2中读出并执行。介质可以是可由计算机2a读取的各种存储介质，也可以是与通信接口2a3连接的通信线路。处理部2a1可以是CPU(Central Processing Unit：中央处理单元)。存储部2a2可以包括RAM(Random Access Memory：随机存取存储器)、ROM(Read Only Memory：只读存储器)、HDD。

24、(Hard Disk Drive：硬盘驱动器)、SSD(Solid State Drive：固态硬盘)、或者它们的组合。通信接口2a3可以经由LAN(Local Area Network：局域网)等通信线路来与等离子体处理装置1之间进行通信。0047下面，对作为等离子体处理装置1的一例的电容耦合型的等离子体处理装置的结构例进行说明。图2是用于说明电容耦合型的等离子体处理装置的结构例的图。0048电容耦合型的等离子体处理装置1包括等离子体处理腔室10、气体供给部20、电源30以及排气系统40。另外，等离子体处理装置1包括基板支承部11和气体导入部。气体导入部构成为将至少一种处理气体导入到等离子体。

25、处理腔室10内。气体导入部包括喷淋头13。基板支承部11配置于等离子体处理腔室10内。喷淋头13配置于基板支承部11的上方。在一个实施方式中，喷淋头13构成等离子体处理腔室10的顶部(ceiling)的至少一部分。等离子体处理腔室10具有由喷淋头13、等离子体处理腔室10的侧壁10a以及基板支承部11规定出的等离子体处理空间10s。等离子体处理腔室10接地。喷淋头13及基板支承部11与等离子体处理腔室10的壳体电绝缘。0049基板支承部11包括主体部111和环形组件112。主体部111具有用于支承基板W的中央区域111a、以及用于支承环形组件112的环状区域111b。晶圆是基板W的一例。俯视观。

26、察时，主体部111的环状区域111b包围主体部111的中央区域111a。基板W配置于主体部111的中央区域111a上，环形组件112以包围主体部111的中央区域111a上的基板W的方式配置于主体部111的环状区域111b上。因而，中央区域111a也称为用于支承基板W的基板支承面，环状区域111b也称为用于支承环形组件112的环形支承面。0050在一个实施方式中，主体部111包括基台1110和静电保持盘1111。基台1110包括导电性构件。基台1110的导电性构件能够作为下部电极发挥功能。静电保持盘1111配置于基台1110上。静电保持盘1111包括陶瓷构件1111a以及配置于陶瓷构件1111a。

27、内的静电电极1111b。陶瓷构件1111a具有中央区域111a。在一个实施方式中，陶瓷构件1111a还具有环状说明书4/10 页7CN 116504623 A7区域111b。此外，如环状静电保持盘、环状绝缘构件那样的包围静电保持盘1111的其它构件也可以具有环状区域111b。在该情况下，环形组件112可以配置于环状静电保持盘或环状绝缘构件之上，也可以配置于静电保持盘1111和环状绝缘构件这两方之上。另外，可以在陶瓷构件1111a内配置有与后述的RF电源31和/或DC电源32耦接的至少一个RF/DC电极。在该情况下，至少一个RF/DC电极作为下部电极发挥功能。在向至少一个RF/DC电极供给后述的。

28、偏压RF信号和/或DC信号的情况下，RF/DC电极也被称为偏压电极。此外，基台1110的导电性构件和至少一个RF/DC电极也可以作为多个下部电极发挥功能。另外，静电电极1111b也可以作为下部电极发挥功能。因而，基板支承部11包括至少一个下部电极。0051环形组件112包括一个或多个环状构件。在一个实施方式中，一个或多个环状构件包括一个或多个边缘环以及至少一个覆盖环。边缘环由导电性材料或绝缘材料形成，覆盖环由绝缘材料形成。0052另外，基板支承部11可以包括温度调节模块，该温度调节模块构成为将静电保持盘1111、环形组件112以及基板中的至少一方调节为目标温度。温度调节模块可以包括加热器、传热。

29、介质、流路1110a、或者它们的组合。在流路1110a中流动如盐水、气体那样的传热流体。在一个实施方式中，流路1110a形成于基台1110内，一个或多个加热器配置于静电保持盘1111的陶瓷构件1111a内。另外，基板支承部11可以包括传热气体供给部，该传热气体供给部构成为向基板W的背面与中央区域111a之间的间隙供给传热气体。0053喷淋头13构成为将来自气体供给部20的至少一种处理气体导入到等离子体处理空间10s内。喷淋头13具有至少一个气体供给口13a、至少一个气体扩散室13b以及多个气体导入口13c。供给到气体供给口13a的处理气体通过气体扩散室13b并从多个气体导入口13c导入到等离子。

30、体处理空间10s内。另外，喷淋头13包括至少一个上部电极。此外，气体导入部除了包括喷淋头13之外，还可以包括安装于在侧壁10a形成的一个或多个开口部的一个或多个侧部气体注入部(SGI：Side Gas Injector)。0054气体供给部20可以包括至少一个气体源21和至少一个流量控制器22。在一个实施方式中，气体供给部20构成为将至少一种处理气体经由各自对应的流量控制器22从各自对应的气体源21供给到喷淋头13。各流量控制器22例如可以包括质量流量控制器或压力控制式的流量控制器。气体供给部20还可以包括将至少一种处理气体的流量进行调制或脉冲化的至少一个流量调制器件。0055电源30包括经由。

31、至少一个阻抗匹配电路来与等离子体处理腔室10耦接的RF电源31。RF电源31构成为向至少一个下部电极和/或至少一个上部电极供给至少一个RF信号(RF电力)。由此，从供给到等离子体处理空间10s的至少一种处理气体形成等离子体。因而，RF电源31能够作为等离子体生成部12的至少一部分发挥功能。另外，通过将偏压RF信号供给到至少一个下部电极，在基板W产生偏压电位，从而能够将所形成的等离子体中的离子成分吸引到基板W。0056在一个实施方式中，RF电源31包括第一RF生成部31a和第二RF生成部31b。第一RF生成部31a构成为：经由至少一个阻抗匹配电路来与至少一个下部电极和/或至少一个上部电极耦接，并。

32、且生成用于生成等离子体的源RF信号(源RF电力)。在一个实施方式中，源RF信号具有10MHz150MHz的范围内的频率。在一个实施方式中，第一RF生成部31a可以构成为生成具有不同频率的多个源RF信号。所生成的一个或多个源RF信号被提供到至少一个下部说明书5/10 页8CN 116504623 A8电极和/或至少一个上部电极。0057第二RF生成部31b构成为：经由至少一个阻抗匹配电路来与至少一个下部电极耦接，并且生成偏压RF信号(偏压RF电力)。偏压RF信号的频率可以与源RF信号的频率相同，也可以不同。在一个实施方式中，偏压RF信号具有比源RF信号的频率低的频率。在一个实施方式中，偏压RF信。

33、号具有100kHz60MHz的范围内的频率。在一个实施方式中，第二RF生成部31b可以构成为生成具有不同频率的多个偏压RF信号。所生成的一个或多个偏压RF信号被提供到至少一个下部电极。另外，在各种实施方式中，可以将源RF信号和偏压RF信号中的至少一方脉冲化。0058另外，电源30可以包括与等离子体处理腔室10耦接的DC电源32。DC电源32包括第一DC生成部32a和第二DC生成部32b。在一个实施方式中，第一DC生成部32a构成为：与至少一个下部电极连接，并且生成第一DC信号。所生成的第一DC信号被施加于至少一个下部电极。在一个实施方式中，第二DC生成部32b构成为与至少一个上部电极连接，并且。

34、生成第二DC信号。所生成的第二DC信号被施加于至少一个上部电极。0059在各种实施方式中，可以将第一DC信号和第二DC信号脉冲化。在该情况下，电压脉冲的序列被施加于至少一个下部电极和/或至少一个上部电极。电压脉冲可以具有矩形、梯形、三角形或这些形状的组合的脉冲波形。在一个实施方式中，用于从DC信号生成电压脉冲的序列的波形生成部连接到第一DC生成部32a与至少一个下部电极之间。因而，第一DC生成部32a和波形生成部构成电压脉冲生成部。在第二DC生成部32b和波形生成部构成电压脉冲生成部的情况下，电压脉冲生成部与至少一个上部电极连接。电压脉冲可以具有正极性，也可以具有负极性。另外，电压脉冲的序列可。

35、以在一个周期内包括一个或多个正极性电压脉冲以及一个或多个负极性电压脉冲。此外，可以在RF电源31的基础上设置第一DC生成部32a和第二DC生成部32b，也可以设置第一DC生成部32a来取代第二RF生成部31b。0060排气系统40例如能够与设置于等离子体处理腔室10的底部的气体排出口10e连接。排气系统40可以包括压力调整阀和真空泵。通过压力调整阀来调整等离子体处理空间10s内的压力。真空泵可以包括涡轮分子泵、干泵或它们的组合。0061图3是一个例示性的实施方式所涉及的蚀刻方法的流程图。图3所示的蚀刻方法MT(下面，称为“方法MT”)能够由上述实施方式的等离子体处理装置1执行。方法MT能够应用。

36、于基板W。0062图4是能够应用图3的方法的一例的基板的截面图。如图4所示，在一个实施方式中，基板W具有含硅膜SF以及含硅膜SF上的掩模MK。基板W可以具有基底区域UR。含硅膜SF可以设置于基底区域UR上。0063掩模MK可以包含碳。掩模MK也可以包含无定形碳。掩模MK可以在含硅膜SF上具有至少一个开口OP。掩模MK也可以具有多个开口OP。开口OP可以是孔图案，也可以是线图案。开口OP的尺寸(宽度)可以是500nm以下。0064含硅膜SF可以包括第一层L1和第二层L2。含硅膜SF可以包括多个第一层L1和多个第二层L2。第一层L1与第二层L2可以交替地层叠。0065第一层L1可以包含第一材料。第。

37、一材料可以包含硅。第一材料可以包含硅氧化物(SiOx)、多晶硅。第二层L2可以包含第二材料。第二材料可以包含硅。第二材料与第一材料不同。第二材料可以包含硅氮化物(SiNx)、多晶硅、有机物。说明书6/10 页9CN 116504623 A90066基底区域UR可以包含硅和金属中的至少一方。基底区域UR可以包含多晶硅，也可以包含钨。0067基板W可以具有配置于含硅膜SF内的至少一个导电性区域CR。可以在含硅膜SF内配置多个导电性区域CR。导电性区域CR可以从掩模MK向下方延伸。导电性区域CR可以在第一层L1与第二层L2的层叠方向上延伸。导电性区域CR的下端可以与基底区域UR分离。0068下面，关。

38、于方法MT，以使用上述实施方式的等离子体处理装置1对基板W应用方法MT的情况为例，参照图3图9进行说明。图5图7分别是示出一个例示性的实施方式所涉及的蚀刻方法的一个工序的截面图。图8是示出一个例示性的实施方式所涉及的蚀刻方法的一个工序的俯视图。图9是沿着图8的IXIX线进行剖切所得到的截面图。在使用等离子体处理装置1的情况下，通过控制部2对等离子体处理装置1的各部进行控制，能够在等离子体处理装置1中执行方法MT。在方法MT中，如图2所示，对配置于等离子体处理腔室10内的基板支承部11(基板支承器)上的基板W进行处理。0069如图3所示，方法MT可以包括工序ST1工序ST11。工序ST1工序ST。

39、11能够依次执行。方法MT也可以不包括工序ST3工序ST5、工序ST8工序ST11中的至少一个工序。0070在工序ST1中，准备图4所示的基板W。基板W在等离子体处理腔室10内能够被基板支承部11支承。基底区域UR能够配置于含硅膜SF与基板支承部11之间。0071在工序ST2中，如图5所示，利用从第一处理气体生成的第一等离子体PL1对含硅膜SF进行蚀刻来形成凹部RS。凹部RS可以具有侧壁RSa和底部RSb。凹部RS与掩模MK的开口OP对应。0072第一处理气体可以包含含有碳和氟的气体。第一处理气体可以包含CxHyFz(x和z为1以上的整数，y为0以上的整数)气体。第一处理气体可以包含含氧气体。。

40、含氧气体可以包含氧气和羰基硫(COS)气体。0073第一等离子体PL1可以在第一压力下生成。第一压力可以是等离子体处理腔室10内的压力。在工序ST2中，可以供给第一高频电力以生成第一等离子体PL1。第一高频电力可以是施加于等离子体处理装置1的上部电极的RF电力HF。在工序ST2中，可以对基板支承部11的主体部111中的电极施加偏压电力LF。0074工序ST2也可以如下那样进行。首先，通过气体供给部20向等离子体处理腔室10内供给第一处理气体。接着，通过等离子体生成部12，在等离子体处理腔室10内从第一处理气体生成第一等离子体PL1。控制部2控制气体供给部20和等离子体生成部12，以利用第一等离。

41、子体PL1对含硅膜SF进行蚀刻来形成凹部RS。0075在工序ST3中，将通过工序ST2沉积于掩模MK的开口OP的沉积物(缩颈)去除。沉积物可能会缩小开口OP的尺寸。沉积物可以包含碳。在工序ST3中，可以对凹部RS进行蚀刻。在工序ST3中，可以向基板W供给从处理气体生成的等离子体。工序ST3中的处理气体可以包含含有碳和氟的气体、以及含氧气体。工序ST3中的含有碳和氟的气体的流量可以比工序ST2中的含有碳和氟的气体的流量小。工序ST3中的含氧气体的流量可以比工序ST2中的含氧气体的流量大。0076在工序ST4中，判定工序ST2的实施次数N是否比阈值N0大。在实施次数N为阈值N0以下的情况下，返回工。

42、序ST2。在该情况下，重复进行工序ST2工序ST3。在实施次数N比阈值N0大的情况下，转到下一个工序ST5。例如，当将阈值N0设定为3时，工序ST2被实施4次。说明书7/10 页10CN 116504623 A100077在工序ST5中，向基板W供给从包含含氧气体的第四处理气体生成的第四等离子体。由此，进行灰化。含氧气体可以包含氧气。第四处理气体可以包含非活性气体。非活性气体可以包含稀有气体。稀有气体可以包含氦气、氖气、氩气、氪气以及氙气中的至少一方。0078在工序ST6中，如图6所示，向基板W供给从包含钨的第二处理气体生成的第二等离子体PL2。可以将第二等离子体PL2供给到凹部RS。可以在凹。

43、部RS的侧壁RSa形成含钨层WL。含钨层WL可以形成于凹部RS的底部RSb。在工序ST6中，可以对凹部RS进行蚀刻。0079第二处理气体可以包含含钨气体。含钨气体可以包含卤化钨气体。卤化钨气体可以包含六氟化钨(WF6)气体、六溴化钨(WBr6)气体、六氯化钨(WCl6)气体以及WF5Cl气体中的至少一方。含钨气体可以包含六羰基钨(W(CO)6)气体。含钨气体的流量可以为10sccm以下。0080第二处理气体可以包含含氧气体和非活性气体中的至少一方。含氧气体可以包含氧气。非活性气体可以包含稀有气体。稀有气体可以包含氦气、氖气、氩气、氪气以及氙气中的至少一方。第二处理气体可以不包含碳。0081第二。

44、等离子体PL2可以在第二压力下生成。第二压力可以是等离子体处理腔室10内的压力。第二压力比工序ST2中的第一压力高。在该情况下，在工序ST6中容易在凹部RS的侧壁RSa形成含钨层WL。第二压力可以为10mTorr(1.333Pa)以上。第二压力可以为100mTorr(13.33Pa)以下。0082在工序ST6中，可以供给第二高频电力以生成第二等离子体PL2。第二高频电力可以是施加于等离子体处理装置1的上部电极的RF电力HF。第二高频电力比工序ST2中的第一高频电力小。在该情况下，在工序ST6中容易在凹部RS的侧壁RSa形成含钨层WL。第二高频电力可以为100W以上。第二高频电力可以为1000W。

45、以下。在工序ST6中，可以不对基板支承部11的主体部111中的电极施加偏压电力LF。即，偏压电力LF可以是0W。0083在工序ST6中，基板支承部11的温度可以为20以上。基板支承部11的温度可以为100以下。0084工序ST6的处理时间可以比工序ST2的处理时间短。工序ST6的处理时间可以根据凹部RS的深度进行调整。例如，可以随着凹部RS变深而延长工序ST6的处理时间。0085工序ST6可以如下那样进行。首先，通过气体供给部20向等离子体处理腔室10内供给包含钨的第二处理气体。接着，通过等离子体生成部12在等离子体处理腔室10内从第二处理气体生成第二等离子体PL2。控制部2控制气体供给部20。

46、和等离子体生成部12，以向基板W供给第二等离子体PL2。0086在工序ST7中，如图7所示，利用从第三处理气体生成的第三等离子体PL3对凹部RS进行蚀刻。工序ST7的蚀刻条件可以与工序ST2的蚀刻条件相同。0087第三处理气体可以包含含有碳和氟的气体。第三处理气体可以包含CxHyFz(x和z为1以上的整数，y为0以上的整数)气体。第三处理气体可以包含含氧气体。含氧气体可以包含氧气和羰基硫(COS)气体。0088工序ST7可以如下那样进行。首先，通过气体供给部20向等离子体处理腔室10内供给第三处理气体。接着，通过等离子体生成部12在等离子体处理腔室10内从第三处理气体生成第三等离子体PL3。控。

47、制部2控制气体供给部20和等离子体生成部12，以利用第三等离子体PL3对凹部RS进行蚀刻。0089在工序ST8中，将通过工序ST7沉积于掩模MK的开口OP的沉积物去除。工序ST8可以说明书8/10 页11CN 116504623 A11与工序ST3在相同的条件下进行。0090在工序ST9中，判定工序ST7的实施次数N是否比阈值N0大。在实施次数N为阈值N0以下的情况下，返回工序ST7。在该情况下，重复进行工序ST7工序ST8。在实施次数N比阈值N0大的情况下，转到下一工序ST10。0091在工序ST10中，判定工序ST6的实施次数M是否比阈值M0大。在实施次数M为阈值M0以下的情况下，返回工序。

48、ST5。在该情况下，重复进行工序ST5工序ST9。在实施次数M比阈值M0大的情况下，转到下一工序ST11。例如，当将阈值M0设定为3时，工序ST6被实施4次。实施次数M可以根据凹部RS的深度进行调整。例如，可以随着凹部RS变深而增加实施次数M。0092在工序ST11中，利用从处理气体生成的等离子体对凹部RS进行蚀刻。由此，如图8所示那样对凹部RS进行过蚀刻。在工序ST11之后，凹部RS的底部RSb可以到达基底区域UR。在工序ST11之后，能够从基板W制造电子器件。电子器件可以是具有三维结构的NAND型闪存。0093在工序ST11中，利用从处理气体生成的等离子体对凹部RS进行蚀刻。由此，如图8和。

49、图9所示那样对凹部RS进行过蚀刻。在工序ST11之后，凹部RS的底部RSb可以到达基底区域UR。在工序ST11之后，能够从基板W制造电子器件。电子器件可以是具有三维结构的NAND型闪存0094根据方法MT，能够改善凹部RS的边缘粗糙度。在凹部RS为线图案的情况下，能够改善凹部RS的LER(线边缘粗糙度)。在凹部RS为孔图案的情况下，能够改善凹部RS的尺寸均匀性(例如圆度)。在从含硅膜SF的厚度方向观察时，通过测定相对于沿着凹部RS的底部RSb的一个边缘的基准直线的偏差，来计算凹部RS的LER。根据上述方法MT，能够形成具有良好的形状的凹部。推测机理如下，但并不限定于此。0095图10是示出通过。

50、蚀刻形成的凹部的边缘粗糙度发生恶化的机理的例子的截面图。在通过蚀刻来形成凹部RS时，电子EL被掩模MK捕获。另外，凹部RS的侧壁RSa不均匀地带电有正电荷，由此在凹部RS的侧壁RSa的一部分形成带电区域EC。在不进行工序ST6的情况下，用于蚀刻的等离子体中的正离子ET在带电区域EC反弹而对相反的侧壁RSa进行蚀刻。由此，凹部RS的边缘粗糙度恶化。当凹部RS的侧壁RSa被蚀刻时，导电性区域CR可能会在侧壁RSa露出。0096图11是示出通过蚀刻形成的凹部的边缘粗糙度得到改善的机理的例子的截面图。当进行工序ST6时，在凹部RS的侧壁RSa形成导电性的含钨层WL，因此能够去除带电的侧壁RSa的正电荷。